工作內容
參與B5G/6G/低軌衛星通訊接取晶片開發，包含下列任一工作:
1. 基頻晶片架構設計。
2. FPGA RTL 電路開發。
3. 通訊系統整合驗證。
工作說明
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工作縣市:新竹縣市
- 上班地點:新竹縣竹東鎮
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工作待遇:面議
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上班時段:日班,8:00-17:00
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需求人數:不拘
條件要求
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工作經歷:
工作經歷不拘
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學歷要求:碩士
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科系要求:
電機電子工程相關
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專長需求:
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擅長工具:
FPGA Verilog
- 具備駕照:
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其他條件:
1. 碩士(含)以上， 電信/通訊/電機/資訊相關畢。
2. 具無線通訊系統基礎。
3. 熟悉FPGA、Verilog、通訊晶片開發。
4. 具通訊系統開發、系統整合驗證、團隊帶領經驗尤佳。
*請檢附相當於TOEIC 650分之英語測驗成績證明(具外國學歷或外國正式工作經歷者可免)，如無法提供，將安排參加本院英文檢測。
